fpga怎样进行软件倍频

fpga怎样进行软件倍频

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一、altera FPGA 倍频怎么设置

使用IP core, altera里面是PLL,设置输出频率,输入频率,Quartus工具会自动设置倍频和分频因子。也可以手动设置,输出相应频率的时钟。
当然系数是有限制的。

二、要在FPGA上同时实现分配与倍频,那种方法最好?

EDA工具里有现有的IP核可以直接调用。
quartusii的叫pll。
xilinx的叫clocking wizard。

三、把250MHZ时钟信号接入FPGA,倍频到1.25GHZ,上升沿触发,来探测一个信号的电平,怎么做?

可以借鉴借鉴fpga实现tdc的方案

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